Elettronica digitale integrata esercizi

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Aggiornato il 18/04/2026

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Appunti di digital integrated circuit design basati su appunti personali del publisher presi alle lezioni del professore Bonfanti dell’università degli Studi Politecnico di Milano - …

Esame Digital integrated circuit design

Facoltà Ingegneria dell'informazione

Dal corso del Prof. Bonfanti Andrea

Università Politecnico di Milano

A.A. 2015-2016

62 pagine

Appunto

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Estratto del documento

Esercitazione NMOS e PMOS

NMOS configurazione e dettagli tecnici

W=0.375µm, L=0.025µm, W/L=15. Curve usate: transcarico Lo=K W/L.

V_G-V_T)MIN - V_MIN, K=µCox, V_min = min (V_GS-V_T, V_DS, V_DS^sat).

Per V_DS = 25V, V_GS THTranscarico. I=I(V_GS, finale V_DS) con V_DS > V_TH.

Condizioni operative NMOS

Per V_DS > V_min

V_DSM...V_IN = 0.6.

Caratteristiche alternative NMOS

NMOS - W=0.375µm, L=0.25µm, W/L=1.5. Curve scelte: trascurabili.

L_D = k W/L (V_gs - V_t) Min=V_min, k=µCox.

V_min = min (V_DS - V_T, V_OS, V_OS^sat).

Id = I₀ per V_DS = V_gs - V_T ID0 V_gs - V_T - 0.5*V_osat + 1 per V_D > 0.

Comportamento del NMOS

Con V_GS = 0.6V, con V_DS trascorso per cui c'è il picco V_DS- V_t con picco (V_OS - 0.6).

Saturation va in incremento 25µA (V_osVDor - Vpin).

PMOS e comportamento in output

Ottenuto l'output e il V_on, abbiamo che il PMOS elencherà mentre il NMOS è acceso.

Dato che rispetto la I_CV abbiamo che il V_rd-N_on funziona compiutamente come un NMOS di compensazione per eliminare le tensioni non sui quali si trovano quelle di un NMOS.

Condizioni di funzionamento del PMOS

Quando l’output è legato al livello logico permette in modo che con le P degli output di uscire allo stesso modo l’output lo più basso su V_DS e V_R.

V_OSR_D = _{2I_L}K_n ₂: ^W_L₂ K_n V_DS - V_T

Comandi e resistenze del NMOS

Quando l'output e il NMOS ha allungato e comanda una resistenza e si ripete al NMOS iii sub-strato (V_DS o V_R) = p-NOS.

V_D = -2.61. È importante che questa resistenza che V_D ripetere in modo che resi.

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