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We can provide a complete solution for software-to-FPGA development:
- Impulse tools provide a software-oriented, highly productive method of design;
- 3rd-party accelerator cards and modules provide high performance and deployment scalability;
- Ready-to-run reference examples provide a fast path to success;
- Training and custom design services are available

Esame di Sistemi embedded docente Prof. L. Pomante

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ESTRATTO DOCUMENTO

Impulse Xilinx Design Flow

Impulse CoDeveloper™

C language

application

Compile

and

optimize

Generate Generate

FPGA hardware

hardware interfaces Xilinx ISE™ Design Suite

HDL

files

ISE™ Design Suite

FPGA

bitmap 5

www.ImpulseAccelerated.com

Impulse Altera Design Flow

‰ Impulse C integrates

with FPGA vendor tools

‰ SOPC Builder

‰ Quartus II

‰ Export Impulse C

modules as IP cores

‰ Connect to Avalon 6

www.ImpulseAccelerated.com

Embedded Processor Acceleration

DSP filter

System

System acceleration

Reset

Reset Custom

Custom

FSL C-language

C-language

hardware

hardware

JTAG

JTAG coprocessor

coprocessor

Block

Block On-Chip Peripheral Bus – PLB or OPB

On-Chip Peripheral Bus – PLB or OPB

Memory

Memory

GPIO

UART GPIO

UART Controller

Controller

Single-chip solution for accelerated DSP processing

‰ System integration using Xilinx Platform Studio™ or Altera SOPC

Builder™

‰ DSP filter offloading results in over 100X acceleration over

software-only version

ML507 MPEG2 Demonstration

MPEG2 Acceleration Example

TFT

TFT

GPIO

GPIO

YUV Color IDCT

YUV Color IDCT INTC

INTC

PLB_0

PLB_0

FCB_0

FCB_0 BRAM

BRAM

DDR2

DDR2

APU_0

APU_0

MPEG2 PowerPC

PowerPC SysACE

SysACE

decoding 440

440 UART

UART

and display Xilinx ML507

Complete HW/SW system on a single FPGA device 8

www.ImpulseAccelerated.com

Multiprocessing MPEG2 Filtering

Web server TEMAC

TEMAC

and TFT PowerPC

PowerPC

440

display 440 TFT

TFT

(VxWorks)

(VxWorks)

control PLB_1

APU_1 PLB_1

APU_1 INTC

INTC

BRAM

BRAM

FCB_1

FCB_1 DDR2

DDR2

UART

UART

Image Filter

Image Filter GPIO

GPIO

YUV Color IDCT

YUV Color IDCT INTC

INTC

FCB_0

FCB_0 BRAM

PLB_0 BRAM

PLB_0 DDR2

DDR2

APU_0

APU_0

MPEG2 Xilinx ML510

PowerPC

PowerPC SysACE

decoding SysACE

440

440

and filtering (standalone)

(standalone) UART

UART


PAGINE

12

PESO

1.69 MB

AUTORE

Atreyu

PUBBLICATO

+1 anno fa


DETTAGLI
Corso di laurea: Corso di laurea magistrale in ingegneria delle telecomunicazioni
SSD:
Università: L'Aquila - Univaq
A.A.: 2011-2012

I contenuti di questa pagina costituiscono rielaborazioni personali del Publisher Atreyu di informazioni apprese con la frequenza delle lezioni di Sistemi embedded e studio autonomo di eventuali libri di riferimento in preparazione dell'esame finale o della tesi. Non devono intendersi come materiale ufficiale dell'università L'Aquila - Univaq o del prof Pomante Luigi.

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